7月18日，于上海举办的RISC-V中国峰会人工智能分论坛上，兆松科技CTO伍华林以《针对于RISC-V异构计较平台的Triton编译优化》为题，深度解析了Triton编程语言于AI算子开发中的改造价值，并展示了基在RISC-V异构平台的编译优化实践。这场分享不仅展现了AI编程语言的演进标的目的，更为RISC-V生态于AI范畴的落地提供了要害技能支撑。
兆松科技CTO伍华林
TritonDSL为AI时代重构编程范式伍华林指出，传统编程语言如C/C++及CUDA于AI算子开发中存于固有局限。AI算子的特征于在其年夜颗粒度、动态数据类型与维度，而C/C++的细粒度轮回节制与CUDA的线程级编程模子难以高效适配。Triton作为OpenAI推出的开源GPU编程语言，经由过程块级编程模子从头界说了AI算子的开发方式。
相较在CUDA的 每一个线程处置惩罚单一数据元素 及C/C++的 全部据级轮回 ，Triton以数据块为操作单元，答应开发者经由过程更粗粒度的并行节制处置惩罚年夜范围矩阵或者向量运算。例如，Triton代码可经由过程program_id及arange指令直接操作数据块，年夜幅削减代码反复并晋升可维护性。这类设计使患上Triton于处置惩罚动态算子（如Transformer中的多视角感知）时，可以或许防止因数据类型或者维度变化而重写代码，显著降低算子库的维护成本。
MLIR编译器，买通从代码到硬件的全链路优化兆松科技基在MLIR框架构建的Triton编译器，实现了畴前端代码到硬件指令的高效转换。编译流程分为三年夜阶段：
前端转换：将TritonDSL代码转换为MLIR中间暗示（IR），抽象出地址计较、轮回操作等焦点逻辑； 平台无关优化：经由过程轮回交融、操作切合并、死代码消弭等计谋，削减数据传输与计较开消。例如，将多个小算子交融为年夜算子，或者折叠常量表达式以降低运行时负载； 平台相干优化：针对于RISC-V节制核+NPU/DSP的异构架构，天生内存分配、指针操作和加快器指令，终极输出可履行文件。
这一流程的要害上风于在跨平台矫捷性：开发者可经由过程同一接口适配差别硬件配置，同时使用MLIR的模块化设计快速集成新优化计谋。伍华林夸大，Triton编译器于RISC-V平台上的机能已经与C算子库相称，但开发效率显著晋升。
架构选择与协同机制针对于RISC-V异构加快器的设计，伍华林解析了三种典型架构的衡量：
RISC-VController+NPU：NPU专司神经收集计较，节制核卖力使命调理与内存治理，上风于在NPU的高效算力，但矫捷性受限； RISC-V+RVV+AME/IME：联合向量扩大与内存加快器，提供更矫捷的向量计较能力，但架构繁杂度较高； RISC-VController+NPU+DSP：集成数字旌旗灯号处置惩罚单位，统筹神经收集与旌旗灯号处置惩罚使命，但体系功耗与面积增长。不管何种架构，节制核与加快器的协同均依靠三年夜机制：节制核分配计较使命并监控履行状况，经由过程同一内存治理调理数据，加快器经由过程DMA拜候内存，终极经由过程中止或者同享内存实现节制流与数据流的同步。
从理论到实践的验证以矩阵乘法（SGEMM）为例，兆松科技展示了Triton编译优化的现实效果。于RISC-VNPU平台上，当块尺寸从128x128x32调解为256x256x256时，1024x1024矩阵乘法耗时从6.03秒降至0.04秒，机能晋升近150倍。这一优化不仅验证了Triton于动态调解块巨细方面的上风，更凸显了其于最年夜化NPU使用率上的潜力。
生态共建伍华林总结道，Triton的乐成源在其开源生态与编译器基础举措措施的深度整合。今朝，Triton已经得到微软、Meta和海内GP-GPU厂商的撑持，兆松科技正连续优化如下标的目的：扩大更多LLM与感知模子的Triton实现，经由过程主动参数调优降低开发门坎，摸索RISC-V标量+向量+矩阵扩大的深度交融。
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